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Circuit Combinatoires
Codeur/Décodeur/Multiplexeur
A. Rizki
Introduction
Unité
logique
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0
Clavier
Structure générale:
Codeur
• Active un code selon l'une des X entrées
actives
 2n (en général) entrées:
 1 entrée active (valeur 1).
 Les autres sont désactivées (valeur 0).
 Code en sortie : sur n bits
Exemple: Codeur décimal-BCD
A0
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A3
Codeur décimal-BCD: Table de vérité
0 1 2 3 4 5 6 7 8 9 S3 S2 S1 S0
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Décodeur
 Active une des X sorties selon un code
 Code : sur n bits
 Nombre de sorties : 2n (en général)
 Exemple classique de décodeur
A0
A1
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E2 E1 E0 S7 S6 S5 S4 S3 S2 S1 S0
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1 1 1 1 0 0 0 0 0 0 0
Décodeur Binaire-Octal: Equations et Schéma
Décodeurs industriels
• 74 LS 139 : Décodeur 1 parmi 4
• 74 LS 138 : Décodeur 1 parmi 8
Décodeurs industriels
Multiplexeur
• Le multiplexeur est un système combinatoire
ayant pour fonction de sélectionner une parmi 2n
entrées et de la transmettre à la sortie.
• La sélection est faite à l'aide de n lignes d'adresse
• La notation usuelle du MUX est: MUX 2n à 1.
• Par exemple, un MUX 8 à 1 aura 3 lignes
d'adresse.
Multiplexeur
MUX 1 Parmi 2
• 𝑆 = 𝐸0 𝐴 + 𝐸1 𝐴
• V est une entrée de validation
AV
Multiplexeur
Exemple:
• le composant 74153 qui contient deux MUX 4 à 1.
• Le signal supplémentaire G (Strobe) est un signal d'activation
du composant. Si G est inactif, la sortie du MUX sera
obligatoirement inactive.
Les démultiplexeurs
• Ces circuits réalisent l’opération inverse des multiplexeurs :
Le signal d’entrée est transmis vers la sortie (1 parmi 2n)
sélectionnée par les entrées d’adresse (au nombre n).
• Le démultiplexeur est un système combinatoire ayant pour
fonction de transmettre une entrée vers une des 2n sorties.
• La sélection est faite à l'aide de n lignes d'adresse et les
sorties sont mutuellement exclusives.
• La notation usuelle du DEMUX est: DEMUX 1 à 2n.
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  • 2. Introduction Unité logique 1 2 3 4 5 6 7 8 9 0 Clavier Structure générale:
  • 3. Codeur • Active un code selon l'une des X entrées actives  2n (en général) entrées:  1 entrée active (valeur 1).  Les autres sont désactivées (valeur 0).  Code en sortie : sur n bits
  • 5. Codeur décimal-BCD: Table de vérité 0 1 2 3 4 5 6 7 8 9 S3 S2 S1 S0 E0 E1 E2 E3 E4 E5 E6 E7 E8 E9 A3 A2 A1 A0 1 0 0 0 0 0 0 0 0 0 0 0 0 0 0 1 0 0 0 0 0 0 0 0 0 0 0 1 0 0 1 0 0 0 0 0 0 0 0 0 1 0 0 0 0 1 0 0 0 0 0 0 0 0 1 1 0 0 0 0 1 0 0 0 0 0 0 1 0 0 0 0 0 0 0 1 0 0 0 0 0 1 0 1 0 0 0 0 0 0 1 0 0 0 0 1 1 0 0 0 0 0 0 0 0 1 0 0 0 1 1 1 0 0 0 0 0 0 0 0 1 0 1 0 0 0 0 0 0 0 0 0 0 0 0 1 1 0 0 1
  • 6. Décodeur  Active une des X sorties selon un code  Code : sur n bits  Nombre de sorties : 2n (en général)  Exemple classique de décodeur A0 A1 A2
  • 7. E2 E1 E0 S7 S6 S5 S4 S3 S2 S1 S0 0 0 0 0 0 0 0 0 0 0 1 0 0 1 0 0 0 0 0 0 1 0 0 1 0 0 0 0 0 0 1 0 0 0 1 1 0 0 0 0 1 0 0 0 1 0 0 0 0 0 1 0 0 0 0 1 0 1 0 0 1 0 0 0 0 0 1 1 0 0 1 0 0 0 0 0 0 1 1 1 1 0 0 0 0 0 0 0
  • 9. Décodeurs industriels • 74 LS 139 : Décodeur 1 parmi 4
  • 10.
  • 11. • 74 LS 138 : Décodeur 1 parmi 8 Décodeurs industriels
  • 12.
  • 13. Multiplexeur • Le multiplexeur est un système combinatoire ayant pour fonction de sélectionner une parmi 2n entrées et de la transmettre à la sortie. • La sélection est faite à l'aide de n lignes d'adresse • La notation usuelle du MUX est: MUX 2n à 1. • Par exemple, un MUX 8 à 1 aura 3 lignes d'adresse.
  • 15. MUX 1 Parmi 2 • 𝑆 = 𝐸0 𝐴 + 𝐸1 𝐴 • V est une entrée de validation AV
  • 17. Exemple: • le composant 74153 qui contient deux MUX 4 à 1. • Le signal supplémentaire G (Strobe) est un signal d'activation du composant. Si G est inactif, la sortie du MUX sera obligatoirement inactive.
  • 18.
  • 19. Les démultiplexeurs • Ces circuits réalisent l’opération inverse des multiplexeurs : Le signal d’entrée est transmis vers la sortie (1 parmi 2n) sélectionnée par les entrées d’adresse (au nombre n). • Le démultiplexeur est un système combinatoire ayant pour fonction de transmettre une entrée vers une des 2n sorties. • La sélection est faite à l'aide de n lignes d'adresse et les sorties sont mutuellement exclusives. • La notation usuelle du DEMUX est: DEMUX 1 à 2n.